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Gapstone is a Go binding for the Capstone disassembly library. For examples,
try reading the *_test.go files.
Library Author: Nguyen Anh Quynh
Binding Author: Ben Nagy
License: BSD style - see LICENSE file for details
(c) 2013 COSEINC. All Rights Reserved.
THIS FILE WAS AUTO-GENERATED -- DO NOT EDIT!
Command: ./genconst ../capstone/bindings/python/capstone/
2021-10-14T08:50:33-04:00
*/
package gapstone
// #cgo LDFLAGS: -lcapstone
// #cgo freebsd CFLAGS: -I/usr/local/include
// #cgo freebsd LDFLAGS: -L/usr/local/lib
// #include <stdlib.h>
// #include <capstone/capstone.h>
import "C"
// For Capstone Engine. AUTO-GENERATED FILE, DO NOT EDIT [arm_const.py]
const (
ARM_SFT_INVALID = C.ARM_SFT_INVALID
ARM_SFT_ASR = C.ARM_SFT_ASR
ARM_SFT_LSL = C.ARM_SFT_LSL
ARM_SFT_LSR = C.ARM_SFT_LSR
ARM_SFT_ROR = C.ARM_SFT_ROR
ARM_SFT_RRX = C.ARM_SFT_RRX
ARM_SFT_ASR_REG = C.ARM_SFT_ASR_REG
ARM_SFT_LSL_REG = C.ARM_SFT_LSL_REG
ARM_SFT_LSR_REG = C.ARM_SFT_LSR_REG
ARM_SFT_ROR_REG = C.ARM_SFT_ROR_REG
ARM_SFT_RRX_REG = C.ARM_SFT_RRX_REG
)
const (
ARM_CC_INVALID = C.ARM_CC_INVALID
ARM_CC_EQ = C.ARM_CC_EQ
ARM_CC_NE = C.ARM_CC_NE
ARM_CC_HS = C.ARM_CC_HS
ARM_CC_LO = C.ARM_CC_LO
ARM_CC_MI = C.ARM_CC_MI
ARM_CC_PL = C.ARM_CC_PL
ARM_CC_VS = C.ARM_CC_VS
ARM_CC_VC = C.ARM_CC_VC
ARM_CC_HI = C.ARM_CC_HI
ARM_CC_LS = C.ARM_CC_LS
ARM_CC_GE = C.ARM_CC_GE
ARM_CC_LT = C.ARM_CC_LT
ARM_CC_GT = C.ARM_CC_GT
ARM_CC_LE = C.ARM_CC_LE
ARM_CC_AL = C.ARM_CC_AL
)
const (
ARM_SYSREG_INVALID = C.ARM_SYSREG_INVALID
ARM_SYSREG_SPSR_C = C.ARM_SYSREG_SPSR_C
ARM_SYSREG_SPSR_X = C.ARM_SYSREG_SPSR_X
ARM_SYSREG_SPSR_S = C.ARM_SYSREG_SPSR_S
ARM_SYSREG_SPSR_F = C.ARM_SYSREG_SPSR_F
ARM_SYSREG_CPSR_C = C.ARM_SYSREG_CPSR_C
ARM_SYSREG_CPSR_X = C.ARM_SYSREG_CPSR_X
ARM_SYSREG_CPSR_S = C.ARM_SYSREG_CPSR_S
ARM_SYSREG_CPSR_F = C.ARM_SYSREG_CPSR_F
ARM_SYSREG_APSR = C.ARM_SYSREG_APSR
ARM_SYSREG_APSR_G = C.ARM_SYSREG_APSR_G
ARM_SYSREG_APSR_NZCVQ = C.ARM_SYSREG_APSR_NZCVQ
ARM_SYSREG_APSR_NZCVQG = C.ARM_SYSREG_APSR_NZCVQG
ARM_SYSREG_IAPSR = C.ARM_SYSREG_IAPSR
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ARM_SYSREG_IAPSR_NZCVQG = C.ARM_SYSREG_IAPSR_NZCVQG
ARM_SYSREG_IAPSR_NZCVQ = C.ARM_SYSREG_IAPSR_NZCVQ
ARM_SYSREG_EAPSR = C.ARM_SYSREG_EAPSR
ARM_SYSREG_EAPSR_G = C.ARM_SYSREG_EAPSR_G
ARM_SYSREG_EAPSR_NZCVQG = C.ARM_SYSREG_EAPSR_NZCVQG
ARM_SYSREG_EAPSR_NZCVQ = C.ARM_SYSREG_EAPSR_NZCVQ
ARM_SYSREG_XPSR = C.ARM_SYSREG_XPSR
ARM_SYSREG_XPSR_G = C.ARM_SYSREG_XPSR_G
ARM_SYSREG_XPSR_NZCVQG = C.ARM_SYSREG_XPSR_NZCVQG
ARM_SYSREG_XPSR_NZCVQ = C.ARM_SYSREG_XPSR_NZCVQ
ARM_SYSREG_IPSR = C.ARM_SYSREG_IPSR
ARM_SYSREG_EPSR = C.ARM_SYSREG_EPSR
ARM_SYSREG_IEPSR = C.ARM_SYSREG_IEPSR
ARM_SYSREG_MSP = C.ARM_SYSREG_MSP
ARM_SYSREG_PSP = C.ARM_SYSREG_PSP
ARM_SYSREG_PRIMASK = C.ARM_SYSREG_PRIMASK
ARM_SYSREG_BASEPRI = C.ARM_SYSREG_BASEPRI
ARM_SYSREG_BASEPRI_MAX = C.ARM_SYSREG_BASEPRI_MAX
ARM_SYSREG_FAULTMASK = C.ARM_SYSREG_FAULTMASK
ARM_SYSREG_CONTROL = C.ARM_SYSREG_CONTROL
ARM_SYSREG_R8_USR = C.ARM_SYSREG_R8_USR
ARM_SYSREG_R9_USR = C.ARM_SYSREG_R9_USR
ARM_SYSREG_R10_USR = C.ARM_SYSREG_R10_USR
ARM_SYSREG_R11_USR = C.ARM_SYSREG_R11_USR
ARM_SYSREG_R12_USR = C.ARM_SYSREG_R12_USR
ARM_SYSREG_SP_USR = C.ARM_SYSREG_SP_USR
ARM_SYSREG_LR_USR = C.ARM_SYSREG_LR_USR
ARM_SYSREG_R8_FIQ = C.ARM_SYSREG_R8_FIQ
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ARM_SYSREG_LR_ABT = C.ARM_SYSREG_LR_ABT
ARM_SYSREG_SP_ABT = C.ARM_SYSREG_SP_ABT
ARM_SYSREG_LR_UND = C.ARM_SYSREG_LR_UND
ARM_SYSREG_SP_UND = C.ARM_SYSREG_SP_UND
ARM_SYSREG_LR_MON = C.ARM_SYSREG_LR_MON
ARM_SYSREG_SP_MON = C.ARM_SYSREG_SP_MON
ARM_SYSREG_ELR_HYP = C.ARM_SYSREG_ELR_HYP
ARM_SYSREG_SP_HYP = C.ARM_SYSREG_SP_HYP
ARM_SYSREG_SPSR_FIQ = C.ARM_SYSREG_SPSR_FIQ
ARM_SYSREG_SPSR_IRQ = C.ARM_SYSREG_SPSR_IRQ
ARM_SYSREG_SPSR_SVC = C.ARM_SYSREG_SPSR_SVC
ARM_SYSREG_SPSR_ABT = C.ARM_SYSREG_SPSR_ABT
ARM_SYSREG_SPSR_UND = C.ARM_SYSREG_SPSR_UND
ARM_SYSREG_SPSR_MON = C.ARM_SYSREG_SPSR_MON
ARM_SYSREG_SPSR_HYP = C.ARM_SYSREG_SPSR_HYP
)
const (
ARM_MB_INVALID = C.ARM_MB_INVALID
ARM_MB_RESERVED_0 = C.ARM_MB_RESERVED_0
ARM_MB_OSHLD = C.ARM_MB_OSHLD
ARM_MB_OSHST = C.ARM_MB_OSHST
ARM_MB_OSH = C.ARM_MB_OSH
ARM_MB_RESERVED_4 = C.ARM_MB_RESERVED_4
ARM_MB_NSHLD = C.ARM_MB_NSHLD
ARM_MB_NSHST = C.ARM_MB_NSHST
ARM_MB_NSH = C.ARM_MB_NSH
ARM_MB_RESERVED_8 = C.ARM_MB_RESERVED_8
ARM_MB_ISHLD = C.ARM_MB_ISHLD
ARM_MB_ISHST = C.ARM_MB_ISHST
ARM_MB_ISH = C.ARM_MB_ISH
ARM_MB_RESERVED_12 = C.ARM_MB_RESERVED_12
ARM_MB_LD = C.ARM_MB_LD
ARM_MB_ST = C.ARM_MB_ST
ARM_MB_SY = C.ARM_MB_SY
)
const (
ARM_OP_INVALID = C.ARM_OP_INVALID
ARM_OP_REG = C.ARM_OP_REG
ARM_OP_IMM = C.ARM_OP_IMM
ARM_OP_MEM = C.ARM_OP_MEM
ARM_OP_FP = C.ARM_OP_FP
ARM_OP_CIMM = C.ARM_OP_CIMM
ARM_OP_PIMM = C.ARM_OP_PIMM
ARM_OP_SETEND = C.ARM_OP_SETEND
ARM_OP_SYSREG = C.ARM_OP_SYSREG
)
const (
ARM_SETEND_INVALID = C.ARM_SETEND_INVALID
ARM_SETEND_BE = C.ARM_SETEND_BE
ARM_SETEND_LE = C.ARM_SETEND_LE
)
const (
ARM_CPSMODE_INVALID = C.ARM_CPSMODE_INVALID
ARM_CPSMODE_IE = C.ARM_CPSMODE_IE
ARM_CPSMODE_ID = C.ARM_CPSMODE_ID
)
const (
ARM_CPSFLAG_INVALID = C.ARM_CPSFLAG_INVALID
ARM_CPSFLAG_F = C.ARM_CPSFLAG_F
ARM_CPSFLAG_I = C.ARM_CPSFLAG_I
ARM_CPSFLAG_A = C.ARM_CPSFLAG_A
ARM_CPSFLAG_NONE = C.ARM_CPSFLAG_NONE
)
const (
ARM_VECTORDATA_INVALID = C.ARM_VECTORDATA_INVALID
ARM_VECTORDATA_I8 = C.ARM_VECTORDATA_I8
ARM_VECTORDATA_I16 = C.ARM_VECTORDATA_I16
ARM_VECTORDATA_I32 = C.ARM_VECTORDATA_I32
ARM_VECTORDATA_I64 = C.ARM_VECTORDATA_I64
ARM_VECTORDATA_S8 = C.ARM_VECTORDATA_S8
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ARM_VECTORDATA_S64 = C.ARM_VECTORDATA_S64
ARM_VECTORDATA_U8 = C.ARM_VECTORDATA_U8
ARM_VECTORDATA_U16 = C.ARM_VECTORDATA_U16
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const (
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